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dc.contributor.authorMorales Villanueva, Aurelio Federico-
dc.contributor.authorBriceño Aranda, César Alberto-
dc.creatorBriceño Aranda, César Alberto-
dc.creatorBriceño Aranda, César Alberto-
dc.date.accessioned2018-09-21T20:15:01Z-
dc.date.available2018-09-21T20:15:01Z-
dc.date.issued2007-12-01-
dc.identifier.citationMorales Villanueva, A., & Briceño Aranda, C. (2007). Diseño e implementación de una red neuronal en un FPGA para recuperación de patrones. TECNIA, 17(2). https://doi.org/10.21754/tecnia.v17i2.367es
dc.identifier.issn2309-0413-
dc.identifier.urihttp://hdl.handle.net/20.500.14076/13948-
dc.description.abstractEl presente trabajo de investigación muestra el diseño e implementación en hardware basado en dispositivos de lógica programable de alta complejidad como son los FPGAs, de una red neuronal artificial de Hopfield para la recuperación de patrones almacenados, a partir de patrones difusos. Se diseñaron dos redes neuronales artificiales (básica y avanzada), haciéndose uso de herramientas de diseño electrónico EDA y lenguaje de descripción de hardware.es
dc.description.abstractThe present research shows the design and implementation of a Hopfield Artificial Neural NetWork (ANN) for pattern recovery, starting from noisy patterns, based on high complexity programmable logic devices like FPGAs. Two artificial neural networks were designed - one basic, and the advanced one - making use of EDA software tools and Hardware Descripúon Language (HDL) .en
dc.formatapplication/pdfes
dc.language.isospaes
dc.publisherUniversidad Nacional de Ingenieríaes
dc.relation.ispartofseriesVolumen;17-
dc.relation.ispartofseriesNúmero;2-
dc.relation.urihttp://revistas.uni.edu.pe/index.php/tecnia/article/view/367es
dc.rightsinfo:eu-repo/semantics/openAccesses
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/4.0/es
dc.sourceUniversidad Nacional de Ingenieríaes
dc.sourceRepositorio Institucional - UNIes
dc.subjectRed Neuronales
dc.subjectDiseño electrónico automatizadoes
dc.titleDiseño e implementación de una red neuronal en un FPGA para recuperación de patroneses
dc.titleDesign and implementation of a neural network on an FPGA for pattern recoveryen
dc.typeinfo:eu-repo/semantics/articlees
dc.identifier.journalTECNIAes
dc.description.peer-reviewRevisión por pareses
dc.identifier.doihttps://doi.org/10.21754/tecnia.v17i2.367es
dc.contributor.emailamorales@uni.edu.pees
Aparece en las colecciones: Vol. 17 Núm. 2 (2007)

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